计算机组成原理-全通关源码-实验（通关版）---头歌平台
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实验一 数字逻辑---交通灯系统设计(HUST)
| 1 | 7段数码管驱动电路设计 |
实验二 运算器设计(HUST)
| 1 | 8位可控加减法电路设计 | ||||||||
| 2 | CLA182四位先行进位电路设计 | ||||||||
| 3 | 4位快速加法器设计 | ||||||||
| 4 | 16位快速加法器设计 | ||||||||
| 5 | 32位快速加法器设计 | ||||||||
| 6 | 5位无符号阵列乘法器设计 | ||||||||
| 7 | 原码一位乘法器设计 | ||||||||
| 8 | MIPS运算器设计 |
实验三 存储系统设计(HUST)
| 1 | 汉字字库存储芯片扩展实验 | ||||||||
| 2 | MIPS寄存器文件设计 | ||||||||
| 3 | 全相联cache设计 | ||||||||
| 4 | 直接相联cache设计 |
实验四 单总线CPU设计(变长指令周期3级时序)(HUST)
| 1 | MIPS指令译码器设计 | ||||||||
| 2 | 变长指令周期---时序发生器FSM设计 | ||||||||
| 3 | 变长指令周期---时序发生器输出函数设计 | ||||||||
| 4 | 硬布线控制器组合逻辑单元 | ||||||||
| 5 | 变长指令周期---硬布线控制器设计 | ||||||||
| 6 | 变长指令周期---单总线CPU设计 |
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最后结语
Github: Parker-Cui (Cui pengfei) · GitHub
Gitee: 崔鹏飞 (cui_pe_ng_fei) - Gitee.com
Juejin: https://juejin.cn/user/2276467567770442/posts
okokok , 这期内容到这里就结束了,我们有缘再会 😂😂😂 !!!
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