集成电路与版图设计第3课——芯片制造中的天线效应与软连接解析
由于芯片衬底电位在瞬时大电流下发生浮动,导致晶体管的源/漏区与衬底之间的寄生二极管被正偏,从而使本应隔离的电路节点之间形成了一条非预期的、高阻的导电通路。
一、天线效应
1、为什么会有天线效应
在芯片制造过程中,有一步叫做 “等离子刻蚀”,整个环境里充满了高能带电粒子(等离子体)。
在制造过程的中间阶段,一根长长的金属线(M1)已经刻蚀好了,但它下方的栅氧(Gate Oxide)还暴露着,并且它上方的金属层(M2)还没有连接上去,这根长长的金属线,就像一根“天线”,在等离子体环境中会不断地收集、积累电荷。
积累的电荷会寻找一个释放的路径,它们会涌向这根金属线唯一连接的器件——MOS管的栅极,栅极下面是一层极薄(几个原子厚度)的栅氧,它就是一个非常完美的电容器,当积累的电荷电压足够高时,会击穿这层薄薄的栅氧,造成永久性的、不可修复的损伤。
2、解决方案
把这根长线在中间切断,然后通过一个 通孔(Via) 连接到更高层的金属(M2)上,再从M2跳回来,继续连接(不让任何一根金属线长得足以成为一根有效的天线)

3、那么当已经跳到最高层金属时怎么办呢?
在芯片上,会故意制作一些反向偏置的二极管(二极管的反向击穿特性),将它们的一端连接到可能成为天线的金属线上,另一端接在固定的电位,电源VDD或地VSS上。

正常电路工作时:这个二极管处于反向偏置状态,相当于一个极高的电阻(>1MΩ),对电路功能完全没有影响,就像不存在一样。
制造过程中电荷积累时:当天线上的电压升高到超过这个二极管的反向击穿电压时,二极管会瞬间从“绝缘体”变为“导体”。
泄放电荷:积累的电荷会通过这个击穿的二极管形成的通道,泄放到电源或地线上,从而保护了脆弱的栅氧。这个击穿过程在控制得当的情况下是可恢复的(齐纳击穿或雪崩击穿),不会损坏二极管本身。

4、DFM相关思考
天线规则检查(ARC):计算与栅极相连的金属线在每一层制造完成时的累积面积,并与阈值比较进行跳线
# 一个简化的规则文件内部表示
AntennaRule = {
"process_order": ["POLY", "M1", "VIA1", "M2", "VIA2", "M3"], # 工艺步骤顺序
"layer_gate_oxide": { # 定义栅氧层
"layer": "GATE",
"thickness": "1.8nm" # 用于计算电容和击穿电压
},
"charge_collecting_layers": ["POLY", "M1", "M2", "M3"], # 哪些层会收集电荷
"ratio_rules": {
"default": 400.0, # 默认面积比阈值
"M1_to_GATE": 300.0, # 特定层到栅极的阈值
"with_jumper": 1000.0 # 有跳线时的宽松规则
}
}
ps:是否可视,分层highligh违规网络?
二、软连接
1、什么是软连接
由于芯片衬底电位在瞬时大电流下发生浮动,导致晶体管的源/漏区与衬底之间的寄生二极管被正偏,从而使本应隔离的电路节点之间形成了一条非预期的、高阻的导电通路。
2、什么情况下、以及为什么会发生软连接
MOS管的PN之间天然存在着寄生二极管,且衬底本身不是理想导体,他存在寄生电阻;当电路稳定工作时,衬底通过衬底接触孔与固定电位(VDD/VSS)连接,所有寄生二极管都处于反向偏置状态,相当于断开;当芯片内部发生一个瞬时的大电流事件时(大量数字门电路同时开关/同步开关噪声/反相器),如果衬底接触孔数量不足或分布不均,这个大电流流过衬底的寄生电阻时,就会根据欧姆定律 V = I * R,在衬底内部产生一个显著的瞬时电压降。
假设某个区域的衬底电位被抬高了0.7V,此时NMOS管的源极刚好是低电位(0V),那么就会导致PN结的正偏

3、怎么解决软连接问题
解决方案的核心就是:确保衬底电位在任何瞬时情况下都保持稳定。
增加衬底接触孔的数量和密度(比如DRC检查):
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这是最根本的解决方法,不能只在角落和边缘放置衬底接触,必须在标准单元行之间,乃至在大型电路模块的内部,均匀、密集地分布衬底接触(N阱中也是)。
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规则: 设计规则会明确规定 “最大衬底接触间距” 。例如,要求任何晶体管到最近的衬底接触的距离不能超过XX微米。
4、DFM相关思考
电气规则检查和可靠性检查工具会专门有一项规则,用于检查衬底接触的密度和最大距离。那我们的DFM软件能做什么呢?
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可视化衬底电位分布: 通过仿真,以热力图的形式显示在瞬态电流事件下,芯片各处的衬底电位浮动情况,直观地找出高风险区域。
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自动标记“孤岛”器件: 自动识别出那些距离任何衬底接触都太远的晶体管
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提供自动修复建议: 建议或自动在空白区域插入额外的衬底接触孔,以满足密度规则
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